Intel Core Ultra 400 : pourquoi ces puces pourraient tout changer face aux Ryzen X3D

Chez Intel, le début d’année 2026 sera principalement dédié au lancement de ses nouvelles puces mobiles Panther Lake, pour PC portables, en parallèle de la commercialisation moins ambitieuse de processeurs de bureau Arrow Lake-Refresh.

D’ici un an environ, l’entreprise devrait néanmoins être en mesure de commercialiser ses toutes nouvelles puces desktop « Nova Lake-S » (sous l’appellation Intel Core Ultra 400, vraisemblablement), qui marqueront d’importantes avancées techniques.

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Parmi les particularités premières de ces CPUs de nouvelle génération, pressentis pour la fin d’année 2026 ou le début d’année 2027, leur utilisation de mémoire bLLC (Big Last Level Cache). L’idée ? Permettre à Intel d’aller (enfin) chasser dignement sur les terres d’AMD et de ses puces 3D V-cache.

Il faut dire qu’AMD s’apprête de son côté à monter en gamme sur ce terrain, avec l’arrivée d’une nouvelle fournée de puces Zen 5 à double cache X3D pour embarquer jusqu’à 192 Mo de cache sur le futur Ryzen 9 9950X3D2. On sait par ailleurs qu’AMD misera début 2027 sur de nouvelles puces Zen 6 pour continuer de monter en gamme et en performances. Le timing est donc critique pour Intel.

Quatre puces Nova Lake-S embarquant jusqu’à *hum-hum* 288 Mo de bLLC ?

Et justement, selon l’informateur Kopite7kimi, souvent bien renseigné, la firme aurait dans les cartons un total de quatre références de puces Nova Lake-S dotées de mémoire bLLC. Ces quatre puces seraient toutes « Unlocked », et donc en capacité d’être overclockées pour monter en fréquences au besoin.

On apprend en parallèle que deux d’entre elles, les plus haut de gamme, disposeraient chacune de deux Compute Tiles pour embarquer jusqu’à 48 coeurs en plus d’un maximum de 288 Mo de cache bLLC. Quatre coeurs à basse consommation LPE seraient en parallèle installés sur chacune de ces quatre références pour aboutir aux configurations suivantes :

• 2 Compute Tiles regroupant 8+16 coeurs (48 coeurs + 4 LPE coeurs) et 288 Mo bLLC
• 2 Compute Tiles regroupant 8+12 coeurs (40 coeurs + 4 LPE coeurs) et 288 Mo bLLC
• 1 Compute Tile de 8+16 coeurs (24 coeurs + 4 coeurs LPE) et 144 Mo bLLC
• 1 Compute Tile de 8+12 coeurs (20 coeurs + 4 coeurs LPE) et 144 Mo bLLC

Notez que le cache bLLC sera proposé en plus de la mémoire cache L2 et L3 « traditionnelle ». En la matière, ces quatre puces seront donc lourdement équipées. Ces spécifications risquent par contre d’induire un degré de complexité supplémentaire pour les constructeurs de cartes mères, qui devront travailler sur des solutions d’alimentation avancées pour leurs produits de nouvelle génération équipés du socket LGA 1954 (celui qui accompagnera ces nouvelles puces Nova Lake-S), souligne WCCFTech.

Bien entendu, Intel a encore beaucoup de temps devant lui pour faire évoluer ce projet. Il est donc possible que d’ici au lancement, ces quatre références aient vu leurs configurations respectives être modifiées. Prudence donc.